基于FPGA的多路光栅信号采集方案

3 多路光栅信号并行采集

对8 路光栅信号按上述方法进行处理，如图7 所示。在图中所示范围内，传感器1~4产生以下信号：增加18、减少11、先减1再加14、减少13.

观察图中A、B两处的计数，如图8所示。A处传感器1~4的初始值为64,0,8,4,B处可见传感器1~4的计数值为82,-11,21,-9.与产生的脉冲信号完全符合，差模电感说明实现了正确的数据采集。

4 结论广州电感器

本方案适用于低速且输入较多的数据采集装置，对于高速信号，信号周期与时钟周差模电感期相差倍数较小时，此法会造成有效信号的损失，并不适用。当信号周期远大于时钟周期时(Ts > 20Tclk )，引入的临时信号仅仅比原始信号滞后几个时钟周期(该滞后小于并行采样数乘以时钟周期)，整体上可以比较好地还原初始波形。同时，临时信号还能有效消除一个时钟周期内的部分波形抖动，实现准确的低速多输入数据采集。

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